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215 __u64 reg_off = id & ~(REG_MASK | KVM_REG_RISCV_CORE); in core_id_to_str()217 assert((id & KVM_REG_RISCV_TYPE_MASK) == KVM_REG_RISCV_CORE); in core_id_to_str()633 case KVM_REG_RISCV_CORE: in print_reg()682 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.pc),683 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.ra),684 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.sp),685 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.gp),686 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.tp),687 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.t0),688 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.t1),[all …]
364 KVM_REG_RISCV_CORE); in kvm_riscv_vcpu_get_reg_core()397 KVM_REG_RISCV_CORE); in kvm_riscv_vcpu_set_reg_core()805 u64 reg = KVM_REG_RISCV | size | KVM_REG_RISCV_CORE | i; in copy_core_reg_indices()1213 case KVM_REG_RISCV_CORE: in kvm_riscv_vcpu_set_reg()1246 case KVM_REG_RISCV_CORE: in kvm_riscv_vcpu_get_reg()
30 #define RISCV_CORE_REG(name) __kvm_reg_id(KVM_REG_RISCV_CORE, 0, \
225 #define KVM_REG_RISCV_CORE (0x02 << KVM_REG_RISCV_TYPE_SHIFT) macro
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