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26 #define PCIE_LINK_STATUS_REG 0x80 macro125 return (readl(regs_base + PCIE_LINK_STATUS_REG) & in pcie_dw_get_link_speed()131 return (readl(regs_base + PCIE_LINK_STATUS_REG) & in pcie_dw_get_link_width()
23 #define PCIE_LINK_STATUS_REG 0x0080 macro100 u32 val = readl(priv->dbi_base + PCIE_LINK_STATUS_REG); in pcie_dw_get_link_speed()107 u32 val = readl(priv->dbi_base + PCIE_LINK_STATUS_REG); in pcie_dw_get_link_width()
22 return (readl(pci->dbi_base + PCIE_LINK_STATUS_REG) & in pcie_dw_get_link_speed()28 return (readl(pci->dbi_base + PCIE_LINK_STATUS_REG) & in pcie_dw_get_link_width()
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