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17 #define MV_XOR_REGS_OFFSET(unit) (0xF0800) argument19 #define MV_XOR_REGS_OFFSET(unit) (0x60900) argument21 #define MV_XOR_REGS_BASE(unit) (MV_XOR_REGS_OFFSET(unit)) argument24 #define XOR_CHANNEL_ARBITER_REG(unit) (MV_XOR_REGS_BASE(unit)) argument29 #define XOR_CAUSE_REG(unit) (MV_XOR_REGS_BASE(unit) + 0x30) argument30 #define XOR_MASK_REG(unit) (MV_XOR_REGS_BASE(unit) + 0x40) argument31 #define XOR_ERROR_CAUSE_REG(unit) (MV_XOR_REGS_BASE(unit) + 0x50) argument32 #define XOR_ERROR_ADDR_REG(unit) (MV_XOR_REGS_BASE(unit) + 0x60) argument41 #define XOR_TIMER_MODE_CTRL_REG(unit) (MV_XOR_REGS_BASE(unit) + 0x2D0) argument44 #define XOR_INIT_VAL_LOW_REG(unit) (MV_XOR_REGS_BASE(unit) + 0x2E0) argument[all …]
426 #define MV_PEX_IF_REGS_BASE(unit) (MV_PEX_IF_REGS_OFFSET(unit)) argument
16 #define MV_XOR_REGS_OFFSET(unit) (0x60900) argument17 #define MV_XOR_REGS_BASE(unit) (MV_XOR_REGS_OFFSET(unit)) argument20 #define XOR_CHANNEL_ARBITER_REG(unit) (MV_XOR_REGS_BASE(unit)) argument21 #define XOR_CONFIG_REG(unit, chan) (MV_XOR_REGS_BASE(unit) + \ argument23 #define XOR_ACTIVATION_REG(unit, chan) (MV_XOR_REGS_BASE(unit) + \ argument27 #define XOR_CAUSE_REG(unit) (MV_XOR_REGS_BASE(unit)+(0x30)) argument28 #define XOR_MASK_REG(unit) (MV_XOR_REGS_BASE(unit)+(0x40)) argument29 #define XOR_ERROR_CAUSE_REG(unit) (MV_XOR_REGS_BASE(unit)+(0x50)) argument30 #define XOR_ERROR_ADDR_REG(unit) (MV_XOR_REGS_BASE(unit)+(0x60)) argument41 #define XOR_DST_PTR_REG(unit, chan) (MV_XOR_REGS_BASE(unit) + \ argument[all …]
21 #define MV_GPP_REGS_BASE(unit) (0x18100 + ((unit) * 0x40)) argument
319 u32 unit = readl(MCHBAR_REG(0x5938)) & 0xf; in gma_pm_init_pre_vbios() local
77 static inline void __iomem *phy_addr(enum phy_unit unit, u32 addr) in phy_addr()
191 static int mv3310_reset(struct phy_device *phydev, u32 unit) in mv3310_reset()
267 int unit; in f_ospi_config_indir_protocol() local
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